CST中如何使用partial RLC提取寬帶SPICE

作者 | Wang Yuanteng

通常，單一頻點(diǎn)導(dǎo)出的SPICE網(wǎng)表是可讀的，并且只描述結(jié)構(gòu)在該頻率下的行為。對于不需要可讀性但希望在整個(gè)頻段上進(jìn)行精確建模的情況，我們希望使用寬帶SPICE。

雖然仿真實(shí)例013：IC封裝的RLC提取以及等效電路中曾經(jīng)提到過，“RLCG生成的SPICE都是單獨(dú)頻點(diǎn)的結(jié)果，想要得到寬帶的SPICE需要用S參數(shù)加Idem工具進(jìn)行轉(zhuǎn)換”。但時(shí)過境遷，盡管關(guān)于partial RLC的內(nèi)容更新較少，其實(shí)partial RLC早就可以提取寬帶SPICE了。

我們以component library中的Bondwire為例，來看一下具體提取方法。

打開BondWire工程，在求解器設(shè)置界面，選擇Export Settings。

彈出設(shè)置界面：

中間是原有的單頻點(diǎn)導(dǎo)出功能，可以設(shè)定若干個(gè)頻點(diǎn)。下方即導(dǎo)出寬帶SPICE功能。該功能中，求解器使用矢量擬合算法生成SPICE，故同時(shí)可設(shè)置擬合精度。

設(shè)置完成之后，點(diǎn)擊求解器start，仿真結(jié)束后即可在工程文件夾下，Result>SPICE下找到SPICE文件。

另外，值得一提的是，相比之前仿真實(shí)例010:提取局部電感電阻（2020版新功能）和仿真實(shí)例013：IC封裝的RLC提取以及等效電路中介紹的一些功能細(xì)節(jié)，目前partial RLC求解器有一些顯著的更新。例如，可以支持Open 邊界，增加了網(wǎng)格自適應(yīng)功能、電流可視化等功能。感興趣的小伙伴可以自己在新版本體驗(yàn)，幫助文檔中亦有相關(guān)功能說明。